Verilog HDL程序设计教程第2版--聚文网

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编辑推荐

依据Verilog-2001和Verlog-2005语言标准,精讲语言,全面梳理, 按语言本身体系编排内容,涵盖所有常用语法规则,既适合作为必备语法资料查询,也适合有一定设计基础的读者学习提高。 ●精选设计案例,对语言规则用案例做阐释,便于基于项目和案例的教学模式的实施。 ●对语言规则用综合工具和仿真工具验证,力争准确并加深理解。 ●提供电子教学课件。可作为电子、通信、微电子、信息、电路与系统、通信与信息系统及测控技术与仪器等专业本科生和研究生的教学用书,也可供从事电路设计,FPGA和芯片开发的工程技术人员阅读参考。

内容简介

本书系统讲解Verilog HDL的语言规则、语法体系，以Verilog-2001和Verilog-2005两个语言标准为依据，知识点全面、准确。本书主要内容包括Verilog HDL入门、数据类型、表达式、门级和开关级建模、数据流建模、行为级建模、层次结构、任务与函数、Test Bench测试与时序检查、Verilog设计进阶、Verilog有限状态机设计、Verilog HDL驱动I/O外设、Verilog信号处理实例等。

本书可作为电工电子相关专业本科生和研究生的教学用书，也可供从事电路设计和系统开发的工程技术人员参考。

作者简介

王金明，博士，解放军陆军工程大学教授、硕士生导师。曾获军队科技进步一等奖1项，军队科技进步二等奖3项，军队科技进步三等奖5项，获军队级教学成果二等奖1项；获国家发明专利授权2项，软件授权1项；发表论文80余篇，其中SCI、EI收录30余篇；主编教材多部，并入选“十一五”国家规划教材和“十二五”国家规划教材；2013年获军队院校育才奖银奖；2014年由国家留学基金委资助，在美国威斯康星大学麦迪逊分校访问研究1年；指导学生参加全国大学生电子设计竞赛，获全国一等奖、二等奖多项。

第1章 Verilog HDL入门 1
1.1 Verilog HDL的发展简史 1
1.2 Verilog HDL描述的层级和方式 2
1.3 Verilog设计的目标器件 3
1.4 Verilog设计的流程 4
1.4.1 设计输入 4
1.4.2 综合 5
1.4.3 布局布线 5
1.4.4 时序分析 5
1.4.5 功能仿真与时序仿真 6
1.4.6 编程与配置 6
1.5 Verilog HDL的文字规则 6
1.5.1 词法 6
1.5.2 空白符 7
1.5.3 注释 7
1.5.4 操作符 7
1.5.5 字符串 7
1.5.6 关键字 9
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Verilog HDL程序设计教程 第2版

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