数字电路的FPGA设计与实现――基于Quartus Prime和Verilog--聚文网

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内容简介

本书共14个实验, 主要内容包括集成逻辑门电路功能测试、基于原理图的简易数字系统设计、基于HDL的简易数字系统设计、编码器设计、译码器设计、加法器设计、比较器设计、数据选择器设计、触发器设计、同步时序逻辑电路分析与设计、异步时序逻辑电路分析与设计、计数器设计、移位寄存器设计、数模与模数转换等。

第1章数字电路开发平台和工具

1.1 现代数字系统设计基础

1.1.1 硬件描述语言

1.1.2 可编程逻辑器件

1.1.3 FPGA开发流程

1.2 数字系统设计的硬件平台

1.2.1 EP4CE15F23C8N器件

1.2.2 Cyclone IV系列FPGA配置

1.2.3 FPGA高级开发系统的硬件资源

1.3 数字系统设计的软件平台

1.3.1 Quartus Prime的主要特点

1.3.2 Quartus Prime 20.1的安装步骤

1.3.3 安装USB Blaster驱动程序

1.3.4 配置ModelSim

1.4 Verilog HDL语法基础

1.4.1 Verilog HDL模块

1.4.2 标识符定义

1.4.3 逻辑值集合

1.4.4 常量

1.4.5 数据类型

1.4.6 运算符

1.4.7 常用语句

1.4.8 描述方法

1.5 基于FPGA高级开发系统可开展的部分实验

第2章集成逻辑门电路功能测试

2.1 预备知识

2.2 实验内容

2.3 实验步骤

本章任务

本章习题

第3章基于原理图的简易数字系统设计

3.1 预备知识

3.2 实验内容

3.3 实验步骤

本章任务

本章习题

第4章基于HDL的简易数字系统设计

4.1 预备知识

4.2 实验内容

4.3 实验步骤

本章任务

本章习题

第5章编码器设计

5.1 预备知识

5.2 实验内容

5.3 实验步骤

本章任务

本章习题

第6章译码器设计

6.1 预备知识

6.2 实验内容

6.3 实验步骤

本章任务

本章习题

第7章加法器设计

7.1 预备知识

7.2 实验内容

7.3 实验步骤

本章任务

本章习题

第8章比较器设计

8.1 预备知识

8.2 实验内容

8.3 实验步骤

本章任务

本章习题

第9章数据选择器设计

9.1 预备知识

9.2 实验内容

9.3 实验步骤

本章任务

本章习题

第10章触发器设计

10.1 预备知识

10.2 实验内容

10.2.1 RS触发器

10.2.2 D触发器

10.2.3 JK触发器

10.2.4 T触发器

10.3 实验步骤

本章任务

本章习题

第11章同步时序逻辑电路分析与设计

11.1 预备知识

11.2 实验内容

11.2.1 同步时序逻辑电路的分析

11.2.2 同步时序逻辑电路的设计

11.3 实验步骤

本章任务

本章习题

第12章异步时序逻辑电路分析与设计

12.1 预备知识

12.2 实验内容

12.2.1 异步时序逻辑电路的分析

12.2.2 异步时序逻辑电路的设计

12.3 实验步骤

本章任务

本章习题

第13章计数器设计

13.1 预备知识

13.2 实验内容

13.2.1 MSI74163 4位同步二进制加法计数器设计

13.2.2 MSI74160 4位同步十进制加法计数器设计

13.3 实验步骤

本章任务

本章习题

第14章移位寄存器设计

14.1 预备知识

14.2 实验内容

14.3 实验步骤

本章任务

本章习题

第15章数模与模数转换

15.1 预备知识

15.2 实验内容

15.3 实验步骤

本章任务

本章习题

附录A 数字电路FPGA设计常用引脚约束

附录B 《Verilog HDL程序设计规范（LY-STD010-2019）》简介

B.1 排版

B.2 注释

B.3 命名规范

B.4 always块描述方式

B.5 编码规范

B.6 Verilog HDL文件模板

参考文献

数字电路的FPGA设计与实现――基于Quartus Prime和Verilog

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