Verilog HDL数字系统设计原理与实践(普通高等教育电气信息类规划教材)--聚文网

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内容简介

王建民编著的《Verilog HDL数字系统设计原理与实践(普通高等教育电气信息类规划教材)》从应用角度出发，详细介绍了利用硬件描述语言进行数字电路设计的基本原理、基本概念和设计方法，包括 Verilog HDL语法基础、组合逻辑电路、规则时序逻辑电路、有限状态机及数据通道设计，静态时序分析及跨时钟域数据传输的基本概念、设计方法及应用。全书通过大量、完整、规范的设计实例演示各类数字电路的设计过程和描述方法。每章配有习题，以指导读者深入地进行学习。本书既可以作为电子科学与技术、集成电路设计相关专业本科、研究生数字集成电路前端设计教材，也可作为电子信息、电气工程和自动化相关专业FPGA 应用设计课程教材使用。本书配套授课电子课件，需要的教师可登录 www.cmpedu.com免费注册，审核通过后下载，或联系编辑索取（QQ：308596956，电话：010-88379753）。

前言第1章数字系统设计概述 1.1 引言 1.2 模拟电路和数字电路 1.2.1 模拟信号和数字信号 1.2.2 模数转换 1.2.3 模拟电路和数字电路 1.3 数字电路设计 1.3.1 数字电路与系统 1.3.2 数字电路设计流程 1.4 硬件描述语言 1.5 习题和思考题第2章数字电路基础 2.1 变量和函数 2.2 基本逻辑关系 2.2.1 逻辑与 2.2.2 逻辑或 2.2.3 逻辑反 2.3 逻辑门和数字电路 2.3.1 晶体管 2.3.2 逻辑门 2.3.3 逻辑电路的表示 2.4 布尔代数和卡诺图 2.4.1 布尔代数 2.4.2 最小项的定义及其性质 2.4.3 卡诺图法化简逻辑函数 2.5 CMOS逻辑门电路 2.5.1 NMOS逻辑门 2.5.2 CMOS逻辑门 2.6 设计实现 2.6.1 标准芯片 2.6.2 可编程逻辑器件 2.6.3 全定制芯片、标准单元和门阵列 2.7 习题和思考题第3章 Verilog HDL硬件描述语言 3.1 基本概念 3.1.1 模块 3.1.2 空白和注释 3.1.3 关键字 3.1.4 标识符 3.2 数据类型 3.2.1 四值逻辑系统 3.2.2 线网和变量 3.2.3 有符号和无符号数 3.3 层次化设计 3.3.1 设计方法学 3.3.2 模块实例 3.3.3 端口连接规则 3.4 门级描述 3.4.1 多输入门

Verilog HDL数字系统设计原理与实践(普通高等教育电气信息类规划教材)

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